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#define CS35L41_REG_IRQ(_reg, _irq) \ [CS35L41_ ## _irq ## _IRQ] = { \ .reg_offset = (CS35L41_ ## _reg) - CS35L41_IRQ1_STATUS1,\ .mask = CS35L41_ ## _irq ## _MASK \ } /* (0x0000E010) CS35L41_IRQ1_STATUS1 */ #define CS35L41_BST_OVP_ERR_SHIFT 6 #define CS35L41_BST_OVP_ERR_MASK BIT(CS35L41_BST_OVP_ERR_SHIFT) #define CS35L41_BST_DCM_UVP_ERR_SHIFT 7 #define CS35L41_BST_DCM_UVP_ERR_MASK BIT(CS35L41_BST_DCM_UVP_ERR_SHIFT) #define CS35L41_BST_SHORT_ERR_SHIFT 8 #define CS35L41_BST_SHORT_ERR_MASK BIT(CS35L41_BST_SHORT_ERR_SHIFT) #define CS35L41_TEMP_WARN_SHIFT 15 #define CS35L41_TEMP_WARN_MASK BIT(CS35L41_TEMP_WARN_SHIFT) #define CS35L41_TEMP_ERR_SHIFT 17 #define CS35L41_TEMP_ERR_MASK BIT(CS35L41_TEMP_ERR_SHIFT) #define CS35L41_AMP_SHORT_ERR_SHIFT 31 #define CS35L41_AMP_SHORT_ERR_MASK BIT(CS35L41_AMP_SHORT_ERR_SHIFT) enum cs35l41_irq_list { CS35L41_BST_OVP_ERR_IRQ, CS35L41_BST_DCM_UVP_ERR_IRQ, CS35L41_BST_SHORT_ERR_IRQ, CS35L41_TEMP_WARN_IRQ, CS35L41_TEMP_ERR_IRQ, CS35L41_AMP_SHORT_ERR_IRQ, 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