rockchip: gru: update the hynix lpddr3 config to run at 928MHz

Update the DDR config and DRAM driver to allow running at up to
928MHz. Kevin config/clock rate are not being changed, but Gru now
runs at 928 MHz.

BRANCH=none
BUG=chrome-os-partner:51537
TEST=booted Kevin and Gru to Linux prompt. Ran stressapptest for 10 min on Gru,

Change-Id: I66c1a171d5c7d05b2878c7bc5eaa0d436c7a1be2
Signed-off-by: Martin Roth <martinroth@chromium.org>
Original-Commit-Id: 8baf0d82816a7ea1c4428e15caeefa2795d001f9
Original-Change-Id: I5e1d6d1025f10203da8f11afc3bbdf95f133c586
Original-Signed-off-by: Shunqian Zheng <zhengsq@rock-chips.com>
Original-Signed-off-by: Vadim Bendebury <vbendeb@chromium.org>
Original-Reviewed-on: https://chromium-review.googlesource.com/343984
Original-Reviewed-by: Stephen Barber <smbarber@chromium.org>
Reviewed-on: https://review.coreboot.org/15027
Tested-by: build bot (Jenkins)
Reviewed-by: Furquan Shaikh <furquan@google.com>

5 files changed, 1587 insertions, 2 deletions

diff --git a/src/mainboard/google/gru/sdram_configs.c b/src/mainboard/google/gru/sdram_configs.c
index 787b36fa2da7..867459030030 100644
--- a/src/mainboard/google/gru/sdram_configs.c
+++ b/src/mainboard/google/gru/sdram_configs.c
@@ -22,7 +22,13 @@
 #include <types.h>
 
 static struct rk3399_sdram_params sdram_configs[] = {
-#include "sdram_inf/sdram-lpddr3-hynix-4GB.inc"
+#if IS_ENABLED(CONFIG_BOARD_GOOGLE_GRU)
+#include "sdram_inf/gru-sdram-lpddr3-hynix-4GB.inc"
+#elif IS_ENABLED(CONFIG_BOARD_GOOGLE_KEVIN)
+#include "sdram_inf/kevin-sdram-lpddr3-hynix-4GB.inc"
+#else
+#error "What is your board name?"
+#endif
 };
 
 const struct rk3399_sdram_params *get_sdram_config()
diff --git a/src/mainboard/google/gru/sdram_inf/gru-sdram-lpddr3-hynix-4GB.inc b/src/mainboard/google/gru/sdram_inf/gru-sdram-lpddr3-hynix-4GB.inc
new file mode 100644
index 000000000000..41643f36b2df
--- /dev/null
+++ b/src/mainboard/google/gru/sdram_inf/gru-sdram-lpddr3-hynix-4GB.inc
@@ -0,0 +1,1563 @@
+/*
+ * This file is part of the coreboot project.
+ *
+ * This program is free software; you can redistribute it and/or modify
+ * it under the terms of the GNU General Public License as published by
+ * the Free Software Foundation; version 2 of the License.
+ *
+ * This program is distributed in the hope that it will be useful,
+ * but WITHOUT ANY WARRANTY; without even the implied warranty of
+ * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
+ * GNU General Public License for more details.
+ */
+
+{
+	{
+		{
+			.rank = 0x2,
+			.col = 0xA,
+			.bk = 0x3,
+			.bw = 0x2,
+			.dbw = 0x2,
+			.row_3_4 = 0x0,
+			.cs0_row = 0xF,
+			.cs1_row = 0xF,
+			.ddrconfig = 1,
+			{
+				{0x1d191519},
+				{0x14040808},
+				{0x00000002},
+				{0x00006226},
+				{0x00000054},
+				0x00000000
+			}
+		},
+		{
+			.rank = 0x2,
+			.col = 0xA,
+			.bk = 0x3,
+			.bw = 0x2,
+			.dbw = 0x2,
+			.row_3_4 = 0x0,
+			.cs0_row = 0xF,
+			.cs1_row = 0xF,
+			.ddrconfig = 1,
+			{
+				{0x1d191519},
+				{0x14040808},
+				{0x00000002},
+				{0x00006226},
+				{0x00000054},
+				0x00000000
+			}
+		}
+	},
+	.ddr_freq = 928*MHz,
+	.dramtype = LPDDR3,
+	.num_channels = 2,
+	.stride = 13,
+	.odt = 1,
+	{
+		{
+			0x00000700,	/* DENALI_CTL_00_DATA */
+			0x00000000,	/* DENALI_CTL_01_DATA */
+			0x00000000,	/* DENALI_CTL_02_DATA */
+			0x00000000,	/* DENALI_CTL_03_DATA */
+			0x00000000,	/* DENALI_CTL_04_DATA */
+			0x0000005e,	/* DENALI_CTL_05_DATA */
+			0x0002d976,	/* DENALI_CTL_06_DATA */
+			0x000003a6,	/* DENALI_CTL_07_DATA */
+			0x0000247a,	/* DENALI_CTL_08_DATA */
+			0x0000005e,	/* DENALI_CTL_09_DATA */
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+			0x0000005e,	/* DENALI_CTL_13_DATA */
+			0x0002d976,	/* DENALI_CTL_14_DATA */
+			0x000003a6,	/* DENALI_CTL_15_DATA */
+			0x0100247a,	/* DENALI_CTL_16_DATA */
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+			0x00000301,	/* DENALI_CTL_69_DATA */
+			0x00000001,	/* DENALI_CTL_70_DATA */
+			0x00000000,	/* DENALI_CTL_71_DATA */
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+			0x01000000,	/* DENALI_CTL_73_DATA */
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+			0x00040003,	/* DENALI_CTL_75_DATA */
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+			0x00040005,	/* DENALI_CTL_81_DATA */
+			0x38c40000,	/* DENALI_CTL_82_DATA */
+			0x00001c62,	/* DENALI_CTL_83_DATA */
+			0x1c6238c4,	/* DENALI_CTL_84_DATA */
+			0x38c40000,	/* DENALI_CTL_85_DATA */
+			0x00001c62,	/* DENALI_CTL_86_DATA */
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+			0x00000000,	/* DENALI_CTL_91_DATA */
+			0x02020200,	/* DENALI_CTL_92_DATA */
+			0x00020202,	/* DENALI_CTL_93_DATA */
+			0x00030200,	/* DENALI_CTL_94_DATA */
+			0x00040700,	/* DENALI_CTL_95_DATA */
+			0x00000302,	/* DENALI_CTL_96_DATA */
+			0x02000407,	/* DENALI_CTL_97_DATA */
+			0x00000003,	/* DENALI_CTL_98_DATA */
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+			0x00070004,	/* DENALI_CTL_100_DATA */
+			0x00000000,	/* DENALI_CTL_101_DATA */
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index 12deb9ff8788..31b45546c051 100644
--- a/src/mainboard/google/gru/sdram_inf/sdram-lpddr3-hynix-4GB.inc
+++ b/src/mainboard/google/gru/sdram_inf/kevin-sdram-lpddr3-hynix-4GB.inc
@@ -1,3 +1,15 @@
+/*
+ * This file is part of the coreboot project.
+ *
+ * This program is free software; you can redistribute it and/or modify
+ * it under the terms of the GNU General Public License as published by
+ * the Free Software Foundation; version 2 of the License.
+ *
+ * This program is distributed in the hope that it will be useful,
+ * but WITHOUT ANY WARRANTY; without even the implied warranty of
+ * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
+ * GNU General Public License for more details.
+ */
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index 6222b77730c2..ba66230e23e0 100644
--- a/src/soc/rockchip/rk3399/clock.c
+++ b/src/soc/rockchip/rk3399/clock.c
@@ -549,6 +549,10 @@ void rkclk_configure_ddr(unsigned int hz)
 		dpll_cfg = (struct pll_div)
 		{.refdiv = 1, .fbdiv = 100, .postdiv1 = 3, .postdiv2 = 1};
 		break;
+	case 928*MHz:
+		dpll_cfg = (struct pll_div)
+		{.refdiv = 1, .fbdiv = 116, .postdiv1 = 3, .postdiv2 = 1};
+		break;
 	default:
 		die("Unsupported SDRAM frequency, add to clock.c!");
 	}
diff --git a/src/soc/rockchip/rk3399/sdram.c b/src/soc/rockchip/rk3399/sdram.c
index 83c0ee6255da..1536910e2c57 100644
--- a/src/soc/rockchip/rk3399/sdram.c
+++ b/src/soc/rockchip/rk3399/sdram.c
@@ -819,7 +819,7 @@ void sdram_init(const struct rk3399_sdram_params *sdram_params)
 	if ((sdram_params->dramtype == DDR3
 			&& sdram_params->ddr_freq > 800*MHz) ||
 	    (sdram_params->dramtype == LPDDR3
-			&& sdram_params->ddr_freq > 800*MHz) ||
+			&& sdram_params->ddr_freq > 928*MHz) ||
 	    (sdram_params->dramtype == LPDDR4
 			&& sdram_params->ddr_freq > 800*MHz))
 		die("SDRAM frequency is to high!");